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AM3357BZCZA30 IC Chip Mpu Sitara 300MHZ 324 NFBGA ADE Chip
Dettagli:
| Luogo di origine: | originale |
| Marca: | original |
| Certificazione: | original |
| Numero di modello: | AM3357BZCZA30 |
Termini di pagamento e spedizione:
| Quantità di ordine minimo: | 1 |
|---|---|
| Prezzo: | negotiation |
| Imballaggi particolari: | Contenitore di cartone |
| Tempi di consegna: | giorni 1-3working |
| Termini di pagamento: | T/T, L/C |
| Capacità di alimentazione: | 100.000 |
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Informazioni dettagliate |
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| Mfr: | Texas Instruments | Serie: | Sitara™ |
|---|---|---|---|
| Pacchetto: | Vassoio | Stato del prodotto: | Attivo |
| Unità di elaborazione del centro: | ARM® Cortex®-A8 | Numero dei centri/larghezza del bus: | Il 1 centro, 32 bit |
| Velocità: | 300MHz | ||
| Evidenziare: | Chip di AM3357BZCZA30 IC,Mpu Sitara 300MHZ 324NFBGA,324 FBGA ADE Chip |
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Descrizione di prodotto
Mpu Sitara 300mhz 324nfbga del chip di IC del circuito integrato AM3357BZCZA30
Microprocessore IC Sitara™ di ARM® Cortex®-A8 il 1 centro, 32 bit 300MHz 324-NFBGA (15x15)
Specifiche di AM3357BZCZA30
| TIPO | DESCRIZIONE |
| Categoria | Circuiti integrati (CI) |
| Incastonato | |
| Microprocessori | |
| Mfr | Texas Instruments |
| Serie | Sitara™ |
| Pacchetto | Vassoio |
| Stato del prodotto | Attivo |
| Unità di elaborazione del centro | ARM® Cortex®-A8 |
| Numero dei centri/larghezza del bus | Il 1 centro, 32 bit |
| Velocità | 300MHz |
| Co-Processors/DSP | Multimedia; NEON™ SIMD |
| RAM Controllers | LPDDR, DDR2, DDR3, DDR3L |
| Accelerazione dei grafici | Sì |
| Regolatori dell'interfaccia & dell'esposizione | LCD, schermo attivabile al tatto |
| Ethernet | 10/100/1000Mbps (2) |
| SATA | - |
| USB | USB 2.0 + PHY (2) |
| Tensione - ingresso/uscita | 1.8V, 3.3V |
| Temperatura di funzionamento | -40°C ~ 105°C (TJ) |
| Funzioni di sicurezza | Crittografia, generatore di numero casuale |
| Montaggio del tipo | Supporto di superficie |
| Pacchetto/caso | 324-LFBGA |
| Pacchetto del dispositivo del fornitore | 324-NFBGA (15x15) |
| Interfacce supplementari | LATTA, io ² C, McASP, McSPI, MMC/SD/SDIO, UART |
| Numero del prodotto di base | AM3357 |
Caratteristiche di AM3357BZCZA30
• Fino a 1-GHz Sitara™ ARM® Cortex®
- Unità di elaborazione di BitRISC del ‑ A8 32
– Coprocessore di NEON™ SIMD
– 32KB di istruzione L1 e 32KB di rilevazione di Unico errore di CacheWith di dati (parità)
– 256KB del nascondiglio L2 con il codice correttore d'errori (CEE)
– 176KB della ROM dello stivale del Su chip
– 64KB di RAM dedicato
– Emulazione e mettere a punto - JTAG
– Regolatore di interruzione (fino a 128 InterruptRequests)
• Memoria del Su chip (L3 comune RAM)
– 64KB del Su chip per tutti gli usi MemoryController (OCMC) RAM
– Accessibile a tutti i padroni
– Sostiene la conservazione per sveglia veloce
• Interfacce esterne di memoria (EMIF)
– mDDR (LPDDR), DDR2, DDR3, DDR3LController:
– mDDR: 200-MHz orologio (tasso di dati 400-MHz)
– DDR2: 266-MHz orologio (tasso di dati 532-MHz)
– DDR3: 400-MHz orologio (tasso di dati 800-MHz)
– DDR3L: 400-MHz orologio (800-MHz DataRate)
– canale omnibus di dati di 16 bit
– 1GB di spazio indirizzabile totale
– Sostiene un x16 o due x8 la memoria DeviceConfigurations
– Regolatore per tutti gli usi di memoria (GPMC)
– 8 bit ed interfaccia flessibili di AsynchronousMemory di 16 bit con fino a sette ChipSelects (NAND, NÉ, Muxed-NÉ, SRAM)
– Usa il codice di BCH per sostenere 4, 8, o 16-BitECC
– Usa il codice di Hamming per sostenere le CEE di 1 bit
– Modulo dell'indicatore di posizione di errori (OLMO)
– Usato insieme con il toLocate di GPMC indirizza dei polinomi del fromSyndrome di errori di dati generati facendo uso dell'algoritmo del aBCH
– Supporti 4, 8 e 16 bit per posizione di errore 512-ByteBlock basata su BCHAlgorithms
• Sottosistema di comunicazione andIndustrial di sottosistema in tempo reale programmabile dell'unità (PRU-ICSS)
– Protocolli di sostegni quale EtherCAT®, PROFIBUS, PROFINET, EtherNet/IP™ e più
- Unità di elaborazione di BitRISC del ‑ A8 32
– Coprocessore di NEON™ SIMD
– 32KB di istruzione L1 e 32KB di rilevazione di Unico errore di CacheWith di dati (parità)
– 256KB del nascondiglio L2 con il codice correttore d'errori (CEE)
– 176KB della ROM dello stivale del Su chip
– 64KB di RAM dedicato
– Emulazione e mettere a punto - JTAG
– Regolatore di interruzione (fino a 128 InterruptRequests)
• Memoria del Su chip (L3 comune RAM)
– 64KB del Su chip per tutti gli usi MemoryController (OCMC) RAM
– Accessibile a tutti i padroni
– Sostiene la conservazione per sveglia veloce
• Interfacce esterne di memoria (EMIF)
– mDDR (LPDDR), DDR2, DDR3, DDR3LController:
– mDDR: 200-MHz orologio (tasso di dati 400-MHz)
– DDR2: 266-MHz orologio (tasso di dati 532-MHz)
– DDR3: 400-MHz orologio (tasso di dati 800-MHz)
– DDR3L: 400-MHz orologio (800-MHz DataRate)
– canale omnibus di dati di 16 bit
– 1GB di spazio indirizzabile totale
– Sostiene un x16 o due x8 la memoria DeviceConfigurations
– Regolatore per tutti gli usi di memoria (GPMC)
– 8 bit ed interfaccia flessibili di AsynchronousMemory di 16 bit con fino a sette ChipSelects (NAND, NÉ, Muxed-NÉ, SRAM)
– Usa il codice di BCH per sostenere 4, 8, o 16-BitECC
– Usa il codice di Hamming per sostenere le CEE di 1 bit
– Modulo dell'indicatore di posizione di errori (OLMO)
– Usato insieme con il toLocate di GPMC indirizza dei polinomi del fromSyndrome di errori di dati generati facendo uso dell'algoritmo del aBCH
– Supporti 4, 8 e 16 bit per posizione di errore 512-ByteBlock basata su BCHAlgorithms
• Sottosistema di comunicazione andIndustrial di sottosistema in tempo reale programmabile dell'unità (PRU-ICSS)
– Protocolli di sostegni quale EtherCAT®, PROFIBUS, PROFINET, EtherNet/IP™ e più
– Due unità in tempo reale programmabili (PRUs)
– il 32 bit unità di elaborazione di RISC deposito/carica capace di dirigersi a 200 megahertz
– 8KB di istruzione RAM With Single-Error Detection (parità)
– 8KB dei dati RAM With Single-Error Detection (parità)
– Moltiplicatore di 32 bit del Unico ciclo con l'accumulatore di 64 bit
– Il modulo migliorato di GPIO fornisce ShiftIn/verso l'esterno supporto ed il parallelo si aggancia il segnale di esterno
– 12KB di RAM With Single-Error Detection comune (parità)
– Tre banche di registro 120-Byte accessibili da ogni PRU
– Regolatore di interruzione (INTC) per gli eventi dell'input del sistema di trasporto
– Bus locale di interconnessione per il collegamento dei padroni interni ed esterni alle risorse dentro il PRU-ICSS
– Unità periferiche dentro il PRU-ICSS:
– Un porto di UART con i perni di controllo di flusso, supporti fino a 12 Mbps
– Un modulo migliorato di bloccaggio (eCAP)
– Due porte Ethernet MII che sostengono Ethernet industriale, quale EtherCAT
– Un porto di MDIO
• Potere, risistemazione e modulo della gestione dell'orologio (PRCM)
– Controlla l'entrata e l'uscita dei modi di Profondo-sonno e del appoggio
– Responsabile di sonno che ordinano, del commutatore-Fuori di dominio di potere che ordinano, dell'ordinamento di sveglia e del dominio di potere Commutatore-sull'ordinamento
– Orologi
– 15 integrati - all'oscillatore ad alta frequenza 35-MHz utilizzato per generare un orologio di riferimento per il vario sistema e gli orologi periferici
– Sostiene il singolo orologio permettono e disattivano al controllo affinchè i sottosistemi e le unità periferiche facilitino il consumo di energia riduttore
– Cinque ADPLLs per generare gli orologi di sistema
(Sottosistema del MPU, interfaccia della RDT, USB ed unità periferiche [MMC e deviazione standard, UART, SPI, I 2C], L3, L4, Ethernet, GFX [SGX530], orologio LCD del pixel)
Applicazioni di AM3357BZCZA30
• Unità periferiche di gioco
• Automazione domestica ed industriale
• Apparecchi medici del consumatore
• Stampanti
• Sistemi astuti del tributo
• Distributori automatici collegati
• Bilance
• Consoli educative
• Giocattoli avanzati
Classificazioni dell'esportazione & ambientali di AM3357BZCZA30
| ATTRIBUTO | DESCRIZIONE |
| Stato di RoHS | ROHS3 compiacente |
| Livello di sensibilità di umidità (MSL) | 3 (168 ore) |
| Stato di PORTATA | RAGGIUNGA inalterato |
| ECCN | 5A992C |
| HTSUS | 8542.31.0001 |
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